[FPGA] CY7C68013A usb芯片fpga通讯问题求助

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wsmysyn| | 2021-12-22 14:58 | 显示全部楼层
信息感觉有点少
  • 用的哪一个官方的历程, 看图片应该是slave fifo的模式, 同步还是异步, 同步的话, 需要提供时钟IFCLK, 异步的话, 不用提供IFCLK时钟, ,应该是SLRD的边沿读取数据,
  • 上位机用的是API二次开发做的, 还是用的官方control panel那个工具
  • 如果是官方的, 是如何设置
  • 确定PC发送了12345678么, 可以用抓包工具抓一下看看, 确认是否发出去
  • 下位机芯片是否接到完整的数据
  • FlagA这个是fifo什么标志,EF,FF,PF,极性是高有效还是低有效。



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衣露申|  楼主 | 2021-12-22 15:37 | 显示全部楼层
wsmysyn 发表于 2021-12-22 14:58
信息感觉有点少
  • 用的哪一个官方的历程, 看图片应该是slave fifo的模式, 同步还是异步, 同步的话, 需要提 ...

  • 用的官方slave fifo程序,固件,调试工具。 同步模式,fpga输出ifclk,
    flagA是EP2EF,默认极性,flagA一直为高是不是数据一直在端口里没输出出来?
    WeCom Screenshot_20211222153016.png

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    wsmysyn| | 2021-12-22 17:02 | 显示全部楼层
    衣露申 发表于 2021-12-22 15:37
    用的官方slave fifo程序,固件,调试工具。 同步模式,fpga输出ifclk,
    flagA是EP2EF,默认极性,flagA一 ...

    官方的例程, USB固件和FPGA的代码都是官方的么?没有任何修改?
    看上位机上设置应该没问题,
    flagA默认是低有效, 看波形应该非空的,

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    衣露申|  楼主 | 2021-12-22 17:55 | 显示全部楼层
    wsmysyn 发表于 2021-12-22 17:02
    官方的例程, USB固件和FPGA的代码都是官方的么?没有任何修改?
    看上位机上设置应该没问题,
    flagA默认是 ...

    因为板子上的io口不够,我把循环程序里的判断条件删掉了,直接运行IFCONFIG = 0x03;  //external clock input, Slave FIFO interface

    这段程序,看起来是判断IO同步时序用的,不知道有影响吗?
    WeCom Screenshot_20211222175012.png

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    wsmysyn| | 2021-12-22 20:18 | 显示全部楼层
    衣露申 发表于 2021-12-22 17:55
    因为板子上的io口不够,我把循环程序里的判断条件删掉了,直接运行IFCONFIG = 0x03;  //external clock i ...

    done_frm_fpga这是一个临时变量 还是输出到IO上的一个信号?
    看下边的IOC bit0会输出一个信号到fpga看起来是, 这个信号有处理么?如果只执行了ICONFIG=0x03是不是其他的没执行过?
    另外你用的是56pin的还是100pin的, 56pin没有IOC。。。100/128pin才有PC port

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