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请教一下大家都是怎么进行FPGA设计的??

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楼主
jiazhaohui|  楼主 | 2012-4-16 22:24 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我做FPGA设计已经有4年多了,目前我进行FPGA设计还是主要以图形输入为主,只有当实现一些比较复杂的模块时才采用VHDL语言来设计,因为我觉得用图形输入时比较节省逻辑资源,而且设计简单功能的模块和设计顶层模块时用图形输入很方便。目前我还没有完全用VHDL语言来设计过,这是不是说明我还停留在初级水平呢?另外请大家也谈一下自己进行设计FPGA的心得。

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沙发
hiramlee| | 2012-4-16 22:33 | 只看该作者
各位好 我要做一个数字下变频 FFT,不知道什么样的板子可以 我的这个XILINX spartan 3e500不够 恳请指点 感激不尽、

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板凳
mr.king| | 2012-4-16 22:35 | 只看该作者
楼主如果设计状态机,那图形方式不好做又不好维护。估计楼主数字电路还不错吧?喜欢图形。我是只有顶层是图形方式

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地板
小嘿| | 2012-4-16 23:04 | 只看该作者
lz是已是高手竟不自知吖,菜鸟因为数字基础不好才用vhdl,verilog,靠软件来综合成与非门吖;听说fpga的高手都是用门来搭电路的

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lwq030736| | 2012-4-17 11:05 | 只看该作者
当模块比较多,而且相互间连接信号很多的时候,你就会发现图形输入有多麻烦了
而且我不觉得用图形会比用VHDL要省逻辑资源,图形和VHDL都只是一种描述方式而已
能用图形输入画出来的,都能用VHDL描述出来,用VHDL描述出来的也都能转换成图形
总的来说还是VHDL编辑起来方便点

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6
pontiff| | 2012-4-17 11:40 | 只看该作者
方法而已,能做事管他用什么方法呢。
别看有人动不动什么HDL的,叫他画个电路出来就歇菜了

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gregy_cn| | 2012-4-17 16:24 | 只看该作者
我最初设计CPLD和FPGA的时候就是画图,后来感觉有些麻烦,就学了VHDL,之后由于工作需要又改用Verilog。
如果原理图输入我觉得Altera公司提供的工具很好用,但是在xilinx公司的ISE上就=遭罪,Lattice公司的也不好。
最初Verilog语言入门,是做一个UART控制器,一个spartan3片子里装32通道,想想如果当时使用图形输入还真是有些烦躁,不能保证1周完工(记得那时候边学边用verilog完成设计也才1周)。现在用Verilog也有7、8年了,也习惯了,做逻辑、做仿真都还可以——也再没有想过原理图输入的事情。
另外使用语言开发难度小,维护也容易。从技术管理的角度讲,软件工程的方法都适用,版本控制容易,也适合协同工作,最重要的是与平台无关。

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jiazhaohui|  楼主 | 2012-4-17 21:22 | 只看该作者
3楼说的很对,设计状态机用语言来写最方便了,比如写FLASH的控制器、交通灯控制器等,需要较多的状态转换的时序逻辑,用状态机的方法可以很容易就理清楚各种状态之间的逻辑关系,用语言也容易写,也方便阅读和维护。

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9
jiazhaohui|  楼主 | 2012-4-17 21:26 | 只看该作者
打个比方,不知道合适不合适,原理图输入和语言输入的关系,就好比是汇编语言和C语言的关系。

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10
jiazhaohui|  楼主 | 2012-4-17 21:29 | 只看该作者
一看回复我的大部分都是论坛里的资深人士,很是荣幸啊

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11
海川先生| | 2012-4-17 22:09 | 只看该作者
不懂 只听不说

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12
Backkom80| | 2012-4-18 08:40 | 只看该作者
本帖最后由 Backkom80 于 2012-4-18 08:59 编辑

2# hiramlee
没有任何设计参数,就是DDC + FFT 无法估资源,
1,多少点的FFT,位宽多少,性能如何等等,
2,DDC,多少位的,工作频率多少?包不包括滤波器?滤波器的设计参数?

什么都没给怎么估啊,乱搞

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13
Backkom80| | 2012-4-18 08:43 | 只看该作者
1# jiazhaohui
4年FPGA设计了,呵呵,时间是挺长的,但仍觉得使用原理图方式是一个方便的方式,说明楼主还有待进级啊,对新东西接受能力和适应能力不强哈。
嘻嘻,

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Backkom80| | 2012-4-18 08:45 | 只看该作者
3# mr.king
顶层用原理图方式,呵呵,另人想不通的设计思设计理念

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15
Backkom80| | 2012-4-18 08:47 | 只看该作者
4# 小嘿
晕,大锅,不要人云亦云, ok?
自己细细了解下FPGA结构在说可否?

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16
Backkom80| | 2012-4-18 08:50 | 只看该作者
本帖最后由 Backkom80 于 2012-4-18 09:01 编辑

6# pontiff
不要以点代面好不好,
真正的FPGA设计工程师比你见到的菜鸟强的多,懂的多,
不清楚HDL描述的是什么电路,如何用HDL,
不会时序设计,如何描述电路,
不很了解FPGA结构,如何做FPGA设计,
......

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17
Backkom80| | 2012-4-18 08:52 | 只看该作者
7# gregy_cn
严重支持。

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18
Backkom80| | 2012-4-18 08:56 | 只看该作者
学习:择其智者而从之。
友情提醒:网上的东西需用辨证的思维及角度是理解去审识。
N年前有句网络名言:和你聊天的也许是······。

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19
shu081| | 2012-10-7 17:08 | 只看该作者
我是想到什么方便、顺手就用什么方法,不拘泥,只要能完成设计任务~:lol

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20
shu081| | 2012-10-7 17:10 | 只看该作者
我是菜鸟一个:L

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