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[FPGA] sram仿真模型设计

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 楼主| zhulin 发表于 2023-2-3 14:12 | 显示全部楼层 |阅读模式
请教各位高手，通常SRAM写入是按位宽大小整个将数据写入，现要设计一个带bit写控制信号的sram，例如当一个SRAM的数据位宽为8，它的每一个bit都带有一个使能信号，当使能信号高时对应bit写，当使能信号为低时，对应bit不写入，sram保持原来的数据。
请问各位该怎么设计？
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 楼主| zhulin 发表于 2023-2-3 14:12 | 显示全部楼层
只是设计一个仿真模型
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