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产品开发过程中如何提高EFT特性?

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powerantone|  楼主 | 2023-4-21 16:21 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
产品开发过程中如何提高EFT特性?

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沙发
gejigeji521| | 2023-4-23 22:14 | 只看该作者
EFT是什么,没懂

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板凳
七毛钱| | 2023-4-24 15:37 | 只看该作者
能具体说说吗

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地板
AloneKaven| | 2023-5-10 23:57 | 只看该作者
EFT是什么特性?

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5
d1ng2x| | 2023-5-22 15:33 | 只看该作者
用大小电容组合,外部电源必须要经过电容再到达芯片电源端

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6
su1yirg| | 2023-5-22 16:37 | 只看该作者
采用3V 电池作电源时, RST 复位端上拉一个 10KΩ的电阻到 VDD 端。采用 LDO 稳压电源时, RST 复位端上拉一个 100KΩ的电阻到 VDD 端,并且需添加大小为 0.1uF的接地电容

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7
lamanius| | 2023-5-22 17:40 | 只看该作者
选择合适的电容和电阻

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8
b5z1giu| | 2023-5-22 18:42 | 只看该作者
震荡电路尽可能的靠近芯片引脚

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9
y1n9an| | 2023-5-22 19:45 | 只看该作者
最好用光藕等元件隔离

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10
tax2r6c| | 2023-5-22 20:48 | 只看该作者
如果有危险的负载,应加有上拉或下拉电阻以防止芯片损坏时的误动作

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11
cen9ce| | 2023-5-23 06:04 | 只看该作者
加吸干扰信号电路

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12
t1ngus4| | 2023-5-23 07:02 | 只看该作者
减小脉冲的上升沿速度,提高抗干扰能力

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13
liu96jp| | 2023-5-23 09:10 | 只看该作者
用时钟发生器来产生高频时钟信号

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14
lix1yr| | 2023-5-23 10:08 | 只看该作者
设计时将数字信号与脉冲信号分开布线就好了

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15
suw12q| | 2023-5-23 11:17 | 只看该作者
加个上拉电阻

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16
ex7s4| | 2023-5-23 13:01 | 只看该作者
尽量减少高杂信号的负载

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kaif2n9j| | 2023-5-23 14:23 | 只看该作者
看具体要求,要求高的话试试硬件抗干扰

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jasontu| | 2023-8-16 08:21 | 只看该作者
io串电阻

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朝生| | 2023-9-5 11:53 | 只看该作者
用巨细电容组合,外部电源必需要颠末电容再达到芯片电源端

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duo点| | 2023-9-20 09:44 | 只看该作者
在产品开发过程中,提高EFT特性需要从元件选择、电路设计、滤波、屏蔽、隔离、PCB布局和电源接地方式等方面进行全面考虑和优化。同时,进行充分的测试和验证是保证产品稳定性和可靠性的关键。

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