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GX系列FPGA开发方案

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dzyjc77|  楼主 | 2012-4-25 17:42 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
Cyclone IV 器件系列是建立在一个优化的低功耗工艺基础之上,并提供以下两种型
号:
Cyclone IV E— 最低的功耗,通过最低的成本实现较高的功能性
Cyclone IV GX— 最低的功耗,集成了3.125 Gbps 收发器的最低成本的FPGA

Cyclone IV 器件集成了一个可选择的低成本收发器,在未影响性能的情况下,节省了功耗及成本。针对无线、有线、广播、工业,用户以及通信等行业中的低成本的小型应用,Cyclone IV 器件无疑是最理想的选择。

Cyclone IV 器件系列主要特性:

低成本、低功耗的FPGA 架构:
6 K 150 K 的逻辑单元

高达6.3 Mb 的嵌入式存储器

高达360 18 × 18 乘法器,实现DSP 处理密集型应用

协议桥接应用,实现小于1.5 W 的总功耗
Cyclone IV GX 器件提供高达八个高速收发器以支持:

高达3.125 Gbps 的数据速率
8B/10B 编码器/ 解码器
8-bit 或者10-bit 位物理介质附加子层(PMA) 到物理编码子层(PCS) 接口

字节串化器/ 解串器(SERDES)

字对齐器

速率匹配FIFO

公共无线电接口(CPRI) TX 位滑块

电路空闲

动态通道重配置以实现数据速率及协议的即时修改
FPGA 核心架构

Cyclone IV 器件采用了与成功的Cyclone 系列器件相同的核心架构。这一架构包括由四输入查找表(LUTs) 构成的LE, 存储器模块以及乘法器。
每一个Cyclone IV 器件的M9K 存储器模块都具有9 Kbit 的嵌入式SRAM 存储器。您可以把M9K 模块配置成单端口、简单双端口、真双端口RAM 以及FIFO 缓冲器或者ROM,通过配置也可以实现表1-7 中的数据宽度。

Cyclone IV 器件中的乘法器体系结构与现有的Cyclone 系列器件是相同的。嵌入式乘法器模块可以在单一模块中实现一个18 × 18 或两个 9 × 9 乘法器。Altera 针对乘法器模块的使用提供了一整套的DSP IP,其中包括有限脉冲响应(FIR)
快速傅里叶变换(FFT) 和数字控制震荡器(NCO) 功能。Quartus®II 设计软件中的DSP Builder 工具集成了MathWorks Simulink MATLAB 设计环境,从而实现了一体化的DSP 设计流程。
(本文由Cogo商城-IC元器件在线采购平台搜集整理,
浏览http://www.cogobuy.com/product/2-3-5-22.html了解更多详细信息)

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