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LM3S的UART中FIFO深度选择的一点问题

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楼主
yzjgod|  楼主 | 2012-4-26 16:29 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
FIFO, UART, lm, 触发, CPU
比如说FIFO默认的1/2满，接收中断触发，此时触发的中断是不是说接收的数据还没有全部接收完毕，只是收了4位，这样程序还要一直等待数据接收完毕。如果是这样的话，接收中断就占用了大量的程序时间，CPU的效率实在是太低了啊。

要是我理解错了，应该是怎么样子的？
谢谢

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沙发
daisyly| | 2012-4-26 16:31 | 只看该作者
:L，马克一下，等结果。

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板凳
yklstam| | 2012-4-26 16:39 | 只看该作者
马克一下

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地板
明天我还来| | 2012-4-26 17:07 | 只看该作者
都没碰到过，更不别深度了解了。

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5楼
永远的不知| | 2012-4-26 17:13 | 只看该作者
1# yzjgod
FIFO是为了节省CPU时间的，设置为1/2满，此时，在收到4个以上字节（不是位）时会产生中断，此时需要您把数据及时取走，因为FIFO只有8个字节，超过8个字节不取走，就会丢失数据。另外，还有超时中断，比如只收到1个字节，在一定时间内未有新字节过来，也会产生中断，这样可以及时提取数据。

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6楼
永远的不知| | 2012-4-26 17:15 | 只看该作者
1# yzjgod
另外也可以设置DMA自动存储数据，就完全可以解放CPU了。

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7楼
yzjgod|  楼主 | 2012-4-27 10:05 | 只看该作者
哦了，我再瞅瞅固件手册怎么写的。

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8楼
TI_MCU| | 2012-4-27 13:39 | 只看该作者
楼主理解有误，UART发送数据以Byte为单位的。FIFO是为了节约CPU资源设计的，所谓1/2设置的是收到一定数据后，提醒内核的时机。

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9楼
binghe41| | 2012-7-17 22:09 | 只看该作者
没看明白

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