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时钟电平请教

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楼主
mylive|  楼主 | 2012-5-2 14:10 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
时钟, 电平, FPGA, PGA, XILINX
现在用xilinx的150T，148.5MHZ的外部时钟幅度只有600mV，不知是否能驱动得了FPGA的时钟管脚呢？多谢了！

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沙发
Backkom80| | 2012-5-2 15:04 | 只看该作者
查看目标芯片datasheet上面关于你所用电气特性所能接受的最小电平值和最大电平值。
光说幅度600mv，没有太大意思
1，直流分量有多少？
2，最大最小值是多少？
3，斜率方面呢？

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板凳
mylive|  楼主 | 2012-5-2 20:13 | 只看该作者
本帖最后由 mylive 于 2012-5-2 20:16 编辑

时钟芯片出来的波形如下：


2# Backkom80

clip_image001.jpg (42.75 KB )

clip_image001.jpg

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地板
可木| | 2012-5-2 22:11 | 只看该作者
贝壳说的对，你对照下目标芯片的datasheet嘛，看看时钟芯片出来的波形是否满足手册上的要求。

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5楼
GoldSunMonkey| | 2012-5-2 23:10 | 只看该作者
对照下目标芯片的datasheet

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6楼
mylive|  楼主 | 2012-5-3 00:00 | 只看该作者
就是不懂，找了还没找到。
4# 可木

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7楼
益友电子| | 2012-5-3 10:38 | 只看该作者
应该没有问题，fpga 的引脚判别电压也不高，ttl电平很容易识别的！

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8楼
Backkom80| | 2012-5-3 12:28 | 只看该作者
呵呵

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9楼
Backkom80| | 2012-5-3 12:28 | 只看该作者
为啥不能是lvcoms的呢？:lol

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10楼
GoldSunMonkey| | 2012-5-3 12:42 | 只看该作者
:)

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11楼
mylive|  楼主 | 2012-5-3 23:20 | 只看该作者
上面那个波形是不对的。这个示波器的带宽只有60MHZ，我改用了一个高级点示波器，峰峰值为2.7V，能满足要求了

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12楼
可木| | 2012-5-4 23:46 | 只看该作者
:lol

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