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[FPGA] 问一个基本问题

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 楼主| entepino 发表于 2023-9-23 18:05 | 显示全部楼层 |阅读模式
电平
为啥ila波形的clk出现图中的0和1，不应该是高电平或低电平吗？为啥是数字？多谢

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 楼主| entepino 发表于 2023-9-23 18:06 | 显示全部楼层
不知道我说清楚没有，就是通道1，应该是1或0波形，为啥是这样？我找了半天设置，也没找到为啥这样。多谢
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 楼主| entepino 发表于 2023-9-23 18:26 | 显示全部楼层
不应该是H，或Ｌ吗？怎么是数字？
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zlf1208 发表于 2023-9-25 08:31 | 显示全部楼层
跟你设定的显示方式有关，在此信号的value处右键，可以选择显示的格式
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