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如何降低电路设计中静态电流？

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楼主
lvyunhua|  楼主 | 2024-1-21 21:37 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
电流, 电路, 电路设计, 静态电流
      如何降低电路设计中的静态电流，个人认为可以从以下几点考虑：
      一、使用静态电流低的集成芯片
      二、在满足电路功能基础上尽可能降低主频
      三、可以用MOS管的地方就不用三极管了
      四、上下拉电阻在满足性能的情况下取值尽量大点
      五、没有用的引脚尽可能通过大阻值电阻上拉到电源或者下拉到地。
      以上纯属个人设计经验，有不对或者不足的地方还望大家多多指导。

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沙发
gaoyang9992006| | 2024-1-22 10:41 | 只看该作者
最近看到好多静态电流的话题，这是个活动吗？

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板凳
643757107| | 2024-1-23 23:21 | 只看该作者
静态电流是浪费掉的电能

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地板
起飞的龙D| | 2024-1-25 10:51 | 只看该作者
静态电流如果过大，整机功耗就过大。

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5楼
lvyunhua|  楼主 | 2024-1-25 12:56 | 只看该作者
最近看到好多静态电流的话题，这是个活动吗？


你看活动专区哦

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6楼
lvyunhua|  楼主 | 2024-1-25 12:58 | 只看该作者
静态电流如果过大，整机功耗就过大。


现在不是要节能环保吗，降低功耗除了休眠唤醒等控制机制，还要整机静态电流低设计

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