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IO口功耗问题

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楼主: gaoggg
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louliana| | 2024-10-8 22:35 | 只看该作者 回帖奖励 |倒序浏览
检查并优化外部电路,确保在单片机进入低功耗模式时,外部电路不会对IO口造成不必要的电平影响。例如,可以通过增加适当的缓冲电路或隔离电路来减小外部电路对IO口的影响。

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chenqianqian| | 2024-10-10 08:04 | 只看该作者
外部高电平的话会有灌电流输入哇

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suncat0504| | 2024-10-14 21:00 | 只看该作者
关闭GPIO的上下拉电阻配置试试。外部输入端可以加高阻值的电阻做提拉。
现状估计是内部上下拉电阻导致的功耗吧。

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suncat0504| | 2024-10-30 18:28 | 只看该作者
修改相关的GPIO口的配置,比如进入高组态,或者改成上拉电阻模式,应该能消除吧。

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申小林一号| | 2024-10-30 20:31 | 只看该作者
设计为漏电流输入

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V853| | 2024-11-2 13:38 | 只看该作者
如果io端口的内部上拉或下拉电阻默认开启,并且低功耗模式下不需要io端口,则应将其关闭。

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digit0| | 2024-11-2 19:09 | 只看该作者
使能内部下拉电阻,使io端口在无外部信号时保持低电平,从而降低漏电流。

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软核硬核| | 2024-11-4 17:10 | 只看该作者
输入状态开启,内部上拉/下拉未开启

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光光雎鸠| | 2024-11-6 10:47 | 只看该作者
一些微控制器在睡眠模式下具有特殊的io端口特性,例如能够完全断开io端口的电源,从而降低功耗。

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朝生| | 2024-11-6 13:27 | 只看该作者
连接外部下拉电阻也有助于稳定io端口电平并降低功耗。

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Pretext| | 2024-11-6 19:23 | 只看该作者
在设计阶段,应考虑外部干扰对IO端口功耗的影响,并采取适当的电磁兼容(emc)措施来降低干扰。

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hmcu666| | 2024-11-8 18:07 | 只看该作者
如果外部电平高,就会有吸电流输入。

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单芯多芯| | 2024-11-10 09:29 | 只看该作者
修改相关gpio端口的配置,例如进入高配置,或者更改为上拉电阻模式,应该能够消除这种情况。

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noDevice| | 2024-11-10 17:52 | 只看该作者
IO口功耗问题需关注电压电流参数,优化电路设计,降低功耗。可采用休眠模式、降低工作频率等方法减少功耗,提高能效。

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