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UART 硬件 FIFO 深度是多少？如何避免数据溢出？

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classroom|  楼主 | 2025-4-14 20:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
FIFO, UART, 硬件
UART 硬件 FIFO 深度是多少？如何避免数据溢出？

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沙发
pssyx| | 2025-4-15 10:05 | 只看该作者
已经量产的CW32 MCU的UART都没有硬件FIFO，只有TDR/RDR寄存器，也就是一个字节。
UART有数据接收溢出中断标志，请监测此位。
如果可以，大量数据传输时，尝试使用DMA。

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板凳
星辰大海不退缩| | 2025-4-15 22:43 | 只看该作者
FIFO一定要确认好时许的额

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地板
清芯芯清| | 2025-5-9 13:51 | 只看该作者
你说的是哪款芯片啊？

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5楼
twinkhahale| | 2025-5-9 15:10 | 只看该作者
一般芯源的现在用的好像都没有fifo硬件缓冲吧

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6楼
szt1993| | 2025-5-18 20:44 | 只看该作者
应该是有校验标志的

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7楼
小小蚂蚁举千斤| | 2025-5-22 12:45 | 只看该作者
其实时序还是比较关键的

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8楼
AdaMaYun| | 2025-5-22 17:32 | 只看该作者
FIFO非常有必要深入细化的

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9楼
快乐制造机| | 2025-5-22 21:41 | 只看该作者
UART的FIFO深度取决于具体的硬件设计，常见的有16、32、64等。具体数值需要查看硬件手册。

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10楼
暖茶轻语| | 2025-5-23 21:22 | 只看该作者
UART的FIFO深度取决于具体的硬件设计，通常在16到256字节之间。具体数值需要查看硬件手册。

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