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[锁相环]

[电路/定理] 这个光耦为什么不能输出高低电平？

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c25c|  楼主 | 2025-6-7 12:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
光耦, 电平, 电路, 输出, 电压, 运放
本帖最后由 c25c 于 2025-6-7 12:26 编辑


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2025-6-5 13:40 上传
最开头运放输入端是正负10mV的信号，通过两个运放满幅放大后再通过D1将负电压钳位到0V附近，通过示波器观察通道1是和预期的一样只有正电压了。但是通道2一直处于高电平，光耦貌似没起作用。请问这是为什么？电路哪些地方设计不合理？

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