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关于clock gating的问题

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glymehrvrd|  楼主 | 2012-7-2 14:36 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
TI, Gating, ck, 数字电路, 电路
是数字电路试卷上的一个问题...没有学习过这方面所以一窍不通，望各路大侠指点

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沙发
jakfens| | 2012-7-2 14:48 | 只看该作者
真够强大的笔试

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板凳
glymehrvrd|  楼主 | 2012-7-2 15:16 | 只看该作者
没有人了解这一块么？？？

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地板
GoldSunMonkey| | 2012-7-2 15:25 | 只看该作者
:)

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5楼
joker319| | 2012-7-2 20:43 | 只看该作者
这种需要扎实的功底，没那实力。

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6楼
lwq030736| | 2012-7-2 23:17 | 只看该作者
本帖最后由 lwq030736 于 2012-7-3 08:51 编辑

第一题

1.21路输入的比较器会因为各输入延迟不一样，在一段很短的时间内产生多种输出状态，所以不能用来做下一级的时钟
原来是同步清0.。看错了
第二题不知道是什么
第三题加一个二选一选择器，比较器的输出作为选择使能端，选择器的输出端接到register的输入端，同时又作为选择器的一个输入。这样在比较器的输出为1时，输出新的值。为0时保持原来的值。就可以实现1Hz enable作为时钟时的功能。二选一就是两个与门加一个非门和或门构成的。
第四题也不知道问什么

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7楼
atua| | 2012-7-4 11:49 | 只看该作者
这显然是学校里面的试题，考查对基本数字电路系统的分析能力的，前三道题穿在一起可以当成门控时钟的一个典型案例来分析。

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8楼
GoldSunMonkey| | 2012-7-4 13:41 | 只看该作者
这显然是学校里面的试题，考查对基本数字电路系统的分析能力的，前三道题穿在一起可以当成门控时钟的一个典型案例来分析。
atua 发表于 2012-7-4 11:49
兄弟，最近来少了啊。

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9楼
gaochy1126| | 2012-7-4 14:10 | 只看该作者
不是设计门电路吗？

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