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xilinx mpmc vfbc仿真的奇怪问题

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wahahaabc|  楼主 | 2012-8-3 13:10 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
仿真, PMC, XILINX, 信号, FIFO
xilinx mpmc  vfbc仿真的问题

（1） VFBC的写命令接口，当给出VFBC的vfbc0_cmd_reset信号以后，reset信号将清空命令FIFO，命令FIFO的full和almost_full信号按道理说应该为0才对， 可实际上命令FIFO的full和almost_full信号一直为1。如下图：



（1） VFBC的写数据接口，当给出VFBC的vfbc0_wd_flush信号以后，flush信号将清空数据FIFO，数据FIFO的full和almost_full信号按道理说应该为0才对， 可实际上数据FIFO的full和almost_full信号一直为1。如下图：






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wahahaabc|  楼主 | 2012-8-4 08:31 | 只看该作者
？？？

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GoldSunMonkey| | 2012-8-4 17:14 | 只看该作者
没有读时钟？

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wahahaabc|  楼主 | 2012-8-5 21:19 | 只看该作者
3# GoldSunMonkey
读写都有时钟 就是上面图中的clk

猴哥 俺还是不会犯这种低级错误滴 呵呵

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5楼
jiangwenj02| | 2015-12-11 21:13 | 只看该作者
本帖最后由 jiangwenj02 于 2015-12-11 21:21 编辑
wahahaabc 发表于 2012-8-5 21:19
3# GoldSunMonkey
读写都有时钟 就是上面图中的clk

你好，我最近在做MPMC VFBC的代码，请问下这个怎么去仿真，有相关的文档或者程序可以提供一下吗？谢谢了。

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6楼
zhaojingzb| | 2015-12-12 16:42 | 只看该作者
应该有ug可以看的。去官网上找找即可

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