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verilog能实现倍频吗？

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楼主
shell.albert|  楼主 | 2012-8-24 21:51 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
verilog, 倍频, HDL, PLL, VerilogHDL
使用verilog hdl能实现倍频吗？
如果使用输入信号的上升沿和下降沿能实现2倍频吗？

怎么感觉有矛盾呢？

我知道PLL肯定能实现，但它的原理是什么呢？

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沙发
GoldSunMonkey| | 2012-8-24 23:42 | 只看该作者
他是模拟器件

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板凳
李冬发| | 2012-8-25 17:54 | 只看该作者
这种方式“倍频”不靠谱。
使用计数法等分同期法就好多了。

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地板
airwill| | 2012-8-25 19:23 | 只看该作者
使用输入信号的上升沿和下降沿, 再加个单稳电路, 可以实现倍频

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5楼
sunmax| | 2012-8-25 21:34 | 只看该作者
没见过~~ 围观

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6楼
GoldSunMonkey| | 2012-8-25 23:34 | 只看该作者
:)

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7楼
hhxb| | 2012-8-27 08:39 | 只看该作者
PLL只能对时钟信号倍频；如果你输入的方波频率远小于系统工作频率，那编一个测频率倍频输出的程序不难；
PLL原理自己百度

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8楼
GoldSunMonkey| | 2012-8-27 21:46 | 只看该作者
:)

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9楼
GoldSunMonkey| | 2012-8-29 20:56 | 只看该作者
:)广告帖，删除

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10楼
jlass| | 2012-8-30 08:56 | 只看该作者
平时都是用PLL倍频的
用上升沿下降沿不能叫倍频吧，只能说是数据传输量*2
DDR2不就是这么处理的嚒

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11楼
GoldSunMonkey| | 2012-8-30 09:13 | 只看该作者
平时都是用PLL倍频的
用上升沿下降沿不能叫倍频吧，只能说是数据传输量*2
DDR2不就是这么处理的嚒
jlass 发表于 2012-8-30 08:56
严重的同意。

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