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去耦电容可以降低电源对地的阻抗？

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erica111|  楼主 | 2012-8-30 16:36 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
电源, 阻抗, 去耦电容, 晶体, 晶体管
电源对地的阻抗是什么啊？我在晶体管电路设计这本书中看到了这句话不能理解，请各位指教一下。

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沙发
HWM| | 2012-8-30 16:43 | 只看该作者
电源对地的阻抗通常就是其内阻。若外电路存在并联负载的话，将负载阻抗并入计算。

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板凳
youimiss| | 2012-8-31 10:28 | 只看该作者
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地板
291355171| | 2012-8-31 12:22 | 只看该作者
我想他说的这个地是系统内的电源地吧，而不是大地吧。带进电容的电抗你在算

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5楼
meng730507| | 2012-8-31 16:00 | 只看该作者
电容大了，阻抗当然会低。特别是芯片本地产生的冲击电流，

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6楼
erica111|  楼主 | 2012-9-19 15:10 | 只看该作者
5# meng730507
是不是利用一个大的去耦电容降低阻抗？那这里需要一个比较大的c？

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7楼
Lgz2006| | 2012-9-19 19:18 | 只看该作者
它不能降低电源作为“源”的内阻！
经常说的是指它能降低对交流信号而言的阻抗
“冲击电流”另当别论

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