DSP和软件无线电

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 楼主| ytf1 发表于 2007-5-25 18:55 | 显示全部楼层 |阅读模式
我们做的一些DSP和软件无线电的板卡和应用,欢迎同行指教。兰州交通大学数字信号处理与软件无线电研究所http://www.sr-dsp.com/<br /><br /><br /><br /><br /><br /><br /> 相关链接:<a href='http://www.sr-dsp.com'>http://www.sr-dsp.com</a>
iversonma 发表于 2007-5-26 20:01 | 显示全部楼层

看来看去两个板子引出n多个项目

如果第二个板子是你们自己做出来的我的确佩服~
 楼主| ytf1 发表于 2007-5-26 21:13 | 显示全部楼层

全部是自己设计的,主要考虑高端应用,当然焊接不是。

  
 楼主| ytf1 发表于 2007-5-26 21:17 | 显示全部楼层

软件无线电板卡的硬件到不是太困难。

软件无线电板卡的硬件设计到不是最困难的,最难的是算法&移植,比如WDDC(宽带的数字下变频器)、数字调制与解调以及各种滤波器等。www.sr-dsp.com<br /><br />
iversonma 发表于 2007-5-26 21:20 | 显示全部楼层

在线亚,呵呵,那问个问题~

<br /><br />FPGA外部标配数据缓存512M字节SDRAM<br />敢问这个sdram的具体型号是什么?<br />SDR不懂,lz所谓的高端应用主要是哪方面呢?能否给扫下盲?<br /><br />主要技术指标:<br />l&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;StratixII&nbsp;EP2S15&nbsp;+&nbsp;TMS320C6414&nbsp;(DSP),33880个宏逻辑单元(LE);&nbsp;&nbsp;1369Kbits嵌入式高速RAM以及64个硬件乘法器(18×18bit);超过500MHz的逻辑工作速度;<br />l&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;DSP定点运算能力4800MIPS(百万次运算每秒);<br />l&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;FPGA外部标配数据缓存512M字节SDRAM,DSP外部标配数据缓存64M字节SDRAM。<br />l&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;板载85MSPS&nbsp;14位AD<br />l&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;PCI2.0&nbsp;接口<br />l&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;包含宽带数字DDC<br />l&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;10层电路板设计,高可靠性和抗干扰性<br />l&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;极高的性能价格比,可完全代替国外同类产品<br />l&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;算法:<br />l&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;WDDC宽带数字下变频器(下变频带宽可任意调节0.5~30M)&nbsp;<br /><br />l&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;PFB多相滤波器组(分组数量可定制)<br />l&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;实时FFT算法<br />l&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;调制与解调数字算法等
 楼主| ytf1 发表于 2007-5-26 21:30 | 显示全部楼层

这样。

这片卡必须&105msps&nbsp;16位的采样率的数据采集卡使用,因为我们原先的设计都是板载AD(最大66MSPS&nbsp;14位),实际发现还是模拟&数字完全分开好,否则动态范围作不上去。另外,这卡主要目的是配合一个中频带宽20M的(F0=70M)宽带接收机做带通采样。我们低端的接收机中频带宽一般不超过10M
iversonma 发表于 2007-5-26 21:46 | 显示全部楼层

lz是高人

我的水平还没有到那一步,只是一个做应用的小工程师,算法类的东西没有接触过多少。等我看看sdr这块再向lz学习学习<br />我觉得你那个512byte的sdram似乎是写错了,看你板子上面芯片似乎没有那么大的sdram。
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