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确保Virtex-5 DDR2 存储器接口的信号完整性

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LongChip|  楼主 | 2012-12-12 20:38 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
DDR, Virtex-5, 存储器接口, 信号完整性, 终端
本文向初次尝试设计 Xilinx® Virtex™-5 DDR2 存储器接口的工程师介绍了一些窍门，包括关于首选电路拓扑的快速指南，以及采用数控阻抗 (DCI) 片上终端元件来替代外部终端电阻器的利弊概述。此外，本文还介绍了笔者从以往的设计中积累的实用设计指南和 IBIS 仿真结果。
519-649-xcell24ab08ddr2.pdf (297.67 KB)


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GoldSunMonkey| | 2012-12-12 21:02 | 只看该作者
感谢分享

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nir| | 2012-12-14 14:18 | 只看该作者
不错，分享有功，:handshake

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GoldSunMonkey| | 2012-12-14 22:32 | 只看该作者
:)你的生意如何？

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5楼
Eagle1986| | 2012-12-15 14:49 | 只看该作者
谢谢分享，先看看

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