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请教FPGA算法原理

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hujnn|  楼主 | 2013-1-8 13:08 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
FPGA, 信号, 数字信号, ADC, adc采集
各位好，最近我在按经理的指导做一个任务
我们用10位的ADC采集模拟电压，转换为10位的数字信号，在把这些10位的数字信号进行累加，一共累加63次，把10位的数字量提高到16位
按经理的说法是精度会提高，但是我想知道这是什么原理？用了什么算法？
我现在就是用一个16位宽的寄存器不停的累加，好像很容易有时间延迟过大的报警

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沙发
lwq030736| | 2013-1-8 14:34 | 只看该作者
累加然后求平均吧，可以滤除一些噪声，精度是可以提高
加法链过长当然会延迟过大，加入流水线就行了

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板凳
jlass| | 2013-1-8 15:39 | 只看该作者
本帖最后由 jlass 于 2013-1-9 09:00 编辑

10位的ADC的最高精度就是10位
你的做法只会使精度无限接近于10位，但绝不会超过10位。
不然你运算个几亿次不是可以把精度提高到几万位。

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地板
Backkom80| | 2013-1-8 17:39 | 只看该作者
就是一个多次累加求平均值，
你工作时钟多少M？
16bit的就时序就有问题了？

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5楼
GoldSunMonkey| | 2013-1-8 18:51 | 只看该作者
jlass 发表于 2013-1-8 15:39
纯属扯淡，10位的ADC的最高精度就是10位
你的做法只会使精度无限接近于10位，但绝不会超过10位。
不 ...

嘿嘿，这个我不清楚

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6楼
GoldSunMonkey| | 2013-1-8 18:51 | 只看该作者
jlass 发表于 2013-1-8 15:39
纯属扯淡，10位的ADC的最高精度就是10位
你的做法只会使精度无限接近于10位，但绝不会超过10位。
不 ...

嘿嘿，这个我不清楚

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7楼
ChaiTF| | 2013-1-12 22:45 | 只看该作者
GoldSunMonkey 发表于 2013-1-8 18:51
嘿嘿，这个我不清楚

还有猴哥不清楚的？

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8楼
she_xiang| | 2013-10-17 16:16 | 只看该作者
累加求平均值，得到的数据要稳定些，

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