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请教：如何使FPGA内部产生的一个时钟信号从多个引脚输出

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luyaoss|  楼主 | 2013-1-9 11:09 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
FPGA, 引脚, 时钟信号, ADC, 控制
思路：用FPGA产生一个时钟信号来控制多个ADC采样；

要求：一个FPGA输出引脚控制一个ADC且同步；

问题：如何实现FPGA内部产生的一个时钟信号从多个引脚输出？

我查到了相关的资料说可以实现这个功能，但是具体的实现方法还在寻找中，望大牛们不惜赐教，小弟在此谢过。

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沙发
gaochy1126| | 2013-1-9 23:01 | 只看该作者
我见过altera的fpga一个引脚可以同时驱动两个ADc的时钟 xilinx的肯定也没有问题的

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