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ddr2 ipcore 应用的问题

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楼主
lxAPP|  楼主 | 2013-1-22 10:52 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
DDR, IPCore, 信号, LTE, altera
谁用过ALTERA ddr2 IPcore，cyclone4器件以前的ip，在这个ip中有一个local_ready信号，为ddr2 sdram反馈回来的信号，数据手册和官方给出的例程中，这个信号都是要老高之后才能对ddr2进行读写访问，但我在仿真时，这个信号时钟为低电平，太伤心了，搞了2周了，还是没通，真是不知道这个ip是怎么写的，之前一直在研究xilinx ddr2 ipcore的应用，本人觉得还是xilinx做的ip规范，而且很好用，没有altera出现的这些错误，而且altera在12.1的版本中，cyclone5的ddr2ipcore和cyclone4之前的ip都不一样，真的是无语了，官方的都有问题，而且速度还不行，谁能解释一下啊，谢谢

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沙发
GoldSunMonkey| | 2013-1-22 22:04 | 只看该作者
这个有什么难呢？

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板凳
GoldSunMonkey| | 2013-1-22 22:04 | 只看该作者
贴图吧

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地板
lxAPP|  楼主 | 2013-1-23 22:15 | 只看该作者
GoldSunMonkey 发表于 2013-1-22 22:04
贴图吧

我是要贴图

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5楼
蓝色风暴@FPGA| | 2013-1-25 11:25 | 只看该作者
2周没调通？我20分钟就搞定了，告诉你一个最简单的方法，把那个example_driver跟DDR IP例化好，signaltap进FPGA里面直接抓时序，你就知道该怎么操作了
我用过Cyclone IV和Spartan-6的DDR IP，Cyclone IV的明显效率比Spartan-6高。

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6楼
qingx| | 2013-1-25 11:27 | 只看该作者
我也来学习下，猴哥给讲解的，一定要听

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7楼
ococ| | 2013-1-25 11:42 | 只看该作者
你仿真的时间长度是多少呢？这个信号貌似是要过几百us后拉高的

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8楼
GoldSunMonkey| | 2013-1-26 00:23 | 只看该作者
ococ 发表于 2013-1-25 11:42
你仿真的时间长度是多少呢？这个信号貌似是要过几百us后拉高的

放佛没人回

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9楼
qin552011373| | 2013-1-27 20:42 | 只看该作者
楼主很不负责

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10楼
GoldSunMonkey| | 2013-1-27 20:48 | 只看该作者
qin552011373 发表于 2013-1-27 20:42
楼主很不负责

是呀，辜负了我的好心

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