29
247
761
高级技术员
使用特权
264
1万
0
实习生
3
73
226
中级技术员
chenzhi658 发表于 2013-1-25 11:42 嗯,猴哥,你老忙吧!年底得个大大的红包
千里风123 发表于 2013-1-25 14:52 AD的转换时间是可以知道的,在CPLD可以启动后等待相应时间再启动下一通道,不用BUSY也可以,30/5=6M,CPLD ...
32
1934
6025
高级工程师
shell.albert 发表于 2013-1-27 21:06 这个应该不难啊。 你的AD可以工作于8MHz,CPLDs降频使用啊。 生成时序直接读数,问题不大啊。 ...
千里风123 发表于 2013-1-28 12:39 分频器在FPGA、CPLD大把应用,一个5分频就是计数器,计5个时钟,在第5个时钟上出个“1”,其他为“0”,不 ...
40
240
906
GoldSunMonkey 发表于 2013-1-28 21:16 这个不难啊
Tianya283 发表于 2013-1-29 22:15 感觉不难
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GoldSunMonkey 发表于 2013-1-29 22:33 你是鹦鹉啊
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