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请教在VHDL程序中配置上拉输出？

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 楼主| llh_kf1100 发表于 2009-3-23 21:54 | 显示全部楼层 |阅读模式
HDL, VHDL, VHDL程序, hd, IO
请教在VHDL程序中配置上拉输出？
我在IO口配置输出为上拉输出时，实现过程中总是报警告，所以我想在程序中配置，这样综合出来就和翻译和配置一致了，不知道可不可以？ 
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songbangyan 发表于 2009-3-25 14:43 | 显示全部楼层

不记得了

我以前用的时候记得有个设置项可以实现，在Q里面，但是很久不用了，记不得了
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