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请教各位:fpga用从串模式配置的时候,MCU应该提供多大频率的CCLK来配置FPGA呢?

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mucanhin|  楼主 | 2013-1-29 22:58 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
沙发
mucanhin|  楼主 | 2013-1-29 22:59 | 只看该作者
求指教

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板凳
zhoumingzr| | 2013-1-29 23:11 | 只看该作者
不知道啊 顶一下

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地板
zbhbyc| | 2013-1-30 09:42 | 只看该作者
具体看你MCU的IO有高点平变为低电平的最短时间,只要按照配置的时序做,不超过最大的时钟频率就好了。当然速度低点的话,稳定性会高点,但是时间会长点。

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hawksabre| | 2013-1-30 20:34 | 只看该作者
不是很了解   顶一个   呵呵 希望有高手能够解决   呵呵

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薇儿安蓝| | 2013-1-31 10:22 | 只看该作者
等大神

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