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基于FPGA的用verilog hdl编写产生spwm波形程序

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楼主
bitandpower|  楼主 | 2013-1-31 00:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
沙发
jakfens| | 2013-1-31 08:59 | 只看该作者
这个百度很多 二姨也有 不过要慢慢找

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板凳
jlass| | 2013-1-31 09:43 | 只看该作者
我想问楼主一句,考试的时候怎么办。

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地板
wfbisheng| | 2013-1-31 09:57 | 只看该作者
http://wenku.baidu.com/view/59068e53ad02de80d4d8404a.html   可以参考一下这个吧。。。。

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wfbisheng| | 2013-1-31 10:00 | 只看该作者
网上很多的呢。。。:)

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6
jahnson066| | 2013-1-31 13:03 | 只看该作者
感觉这个是本科生毕设,哎

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GoldSunMonkey| | 2013-1-31 23:19 | 只看该作者
jahnson066 发表于 2013-1-31 13:03
感觉这个是本科生毕设,哎

有那么大气么??

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qin552011373| | 2013-2-1 20:08 | 只看该作者
GoldSunMonkey 发表于 2013-1-31 23:19
有那么大气么??

有可能哦   现在本科缩水了   如果老师不负责  很有可能出现这样子的毕设

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Backkom80| | 2013-2-5 08:14 | 只看该作者
也许只是课程设计,呵呵

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as@yangjun| | 2013-2-5 08:25 | 只看该作者
网上有

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11
GoldSunMonkey| | 2013-2-5 22:32 | 只看该作者
:)

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12
zheng21he| | 2020-1-9 18:58 | 只看该作者

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