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ZYNQ 702评估板引脚安排失败

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楼主
最近在研究一块新的 ZYNQ 702评估板,用到了他的差分时钟,不过能够准确的P&R,但产生bit文件就报错,
错误信息如下:


ucf 定义如下:

# PlanAhead Generated physical constraints
NET "clk_in_156m25_P" LOC = Y9;
# PlanAhead Generated IO constraints
NET "clk_in_156m25_P" IOSTANDARD = LVDS_25;
# PlanAhead Generated physical constraints
NET "CA_CODE_PROMPT" LOC = H17;

有谁遇到过这个问题?如何解决?
谢谢!!

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沙发
GoldSunMonkey| | 2013-3-12 20:38 | 只看该作者
# PlanAhead Generated IO constraints
NET "clk_in_156m25_P" IOSTANDARD = LVDS_25;

這句屏蔽掉試一下

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板凳
lqlkmqj| | 2013-3-12 20:48 | 只看该作者
支持一下,共同学习,

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地板
GoldSunMonkey| | 2013-3-12 21:15 | 只看该作者
lqlkmqj 发表于 2013-3-12 20:48
支持一下,共同学习,

歡迎

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5
zhushouxi|  楼主 | 2013-3-12 21:25 | 只看该作者
GoldSunMonkey 发表于 2013-3-12 20:38
# PlanAhead Generated IO constraints
NET "clk_in_156m25_P" IOSTANDARD = LVDS_25;

不行...

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6
GoldSunMonkey| | 2013-3-12 21:38 | 只看该作者
版本14.2?

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7
zhushouxi|  楼主 | 2013-3-12 21:39 | 只看该作者
GoldSunMonkey 发表于 2013-3-12 21:38
版本14.2?

14.1

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8
GoldSunMonkey| | 2013-3-12 21:54 | 只看该作者
设置UnconstrainedPins:Allow试一下

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