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新人请教verilog HDL的延时问题。

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楼主
pangning7085|  楼主 | 2013-3-21 10:05 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
HDL, verilog, VerilogHDL, 时钟, 芯片
求高人指点：如何用verilog HDL实现延时1毫秒、2毫秒？芯片的时钟频率为50MHz。还望论坛里的前辈不吝赐教，感激不尽……

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沙发
ifpga| | 2013-3-21 10:09 | 只看该作者
计数器啊，
50M， 一个周就是20ns
1ms = 50,000个周期

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板凳
Backkom80| | 2013-3-21 10:38 | 只看该作者

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地板
pangning7085|  楼主 | 2013-3-21 10:44 | 只看该作者
ifpga 发表于 2013-3-21 10:09
计数器啊，
50M， 一个周就是20ns
1ms = 50,000个周期

像单片机有机器周期一说。例如51系列1个机器周期对应12个时钟周期，如果时钟是24MHz的话，延时1微秒就需要两条汇编语言。verilog HDL需不需要类似的计算呢？

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5楼
ifpga| | 2013-3-21 10:47 | 只看该作者
这是肯定需要计算的啊

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6楼
pangning7085|  楼主 | 2013-3-21 10:56 | 只看该作者
ifpga 发表于 2013-3-21 10:47
这是肯定需要计算的啊

大神，原谅小弟不太懂。。verilog HDL一条指令对应多少机器周期呢？如果你能贴一段程序上来就好了。[

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7楼
pangning7085|  楼主 | 2013-3-21 10:57 | 只看该作者
ifpga 发表于 2013-3-21 10:47
这是肯定需要计算的啊

大神，原谅小弟不太懂……那怎么知道verilog HDL一条语句对应多少机器周期呢？

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8楼
pangning7085|  楼主 | 2013-3-21 10:58 | 只看该作者
pangning7085 发表于 2013-3-21 10:57
大神，原谅小弟不太懂……那怎么知道verilog HDL一条语句对应多少机器周期呢？ ...

不知您有没有相应的程序可以贴来看一下呢？

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9楼
ifpga| | 2013-3-21 11:06 | 只看该作者
兄弟，你是真的没用过 Verilog 啊
建议你找本书看一下
不是给你贴断代码就能解决问题的

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pangning7085 2013-3-21 11:18 回复TA
确实，刚刚开始用。谢谢您~ 
10楼
GoldSunMonkey| | 2013-3-21 21:34 | 只看该作者
ifpga 发表于 2013-3-21 11:06
兄弟，你是真的没用过 Verilog 啊
建议你找本书看一下
不是给你贴断代码就能解决问题的 ...

是呀，还是停留在C语言的海洋中

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11楼
jlass| | 2013-3-22 08:38 | 只看该作者
pangning7085 发表于 2013-3-21 10:57
大神，原谅小弟不太懂……那怎么知道verilog HDL一条语句对应多少机器周期呢？ ...

不是计算一条VHDL语句的时间，而是对外部晶振进行采样

比如使用20M的晶振，一个时钟周期就是1/20M。

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12楼
Backkom80| | 2013-3-22 09:12 | 只看该作者
呵呵，

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13楼
cuianbin| | 2013-3-22 09:46 | 只看该作者
还在用单片机的思想搞！

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14楼
GoldSunMonkey| | 2013-3-23 22:37 | 只看该作者
cuianbin 发表于 2013-3-22 09:46
还在用单片机的思想搞！

是呀是呀

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15楼
lxAPP| | 2013-3-23 23:09 | 只看该作者
单片机的思想不能用在FPGA上啊

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16楼
qin552011373| | 2013-3-24 00:17 | 只看该作者
哈哈哈  自己动手  丰衣足食

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17楼
utopiaworld| | 2013-3-24 13:28 | 只看该作者
整个计数器

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18楼
GoldSunMonkey| | 2013-3-24 21:52 | 只看该作者
utopiaworld 发表于 2013-3-24 13:28
整个计数器

只能是计数器了

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