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关于P0口驱动液晶的上拉电阻

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楼主
fzpxp|  楼主 | 2009-3-28 09:56 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
上拉电阻, 液晶, 单片机, AT89S52, s52
AT89S52单片机的P0口接12864液晶，请问P0口的上拉电阻该是多少啊？1K的行吗？

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沙发
fzpxp|  楼主 | 2009-3-28 10:24 | 只看该作者

AT89S52单片机的P0口接12864液晶

没人？自己顶顶                    

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板凳
sunzefeng| | 2009-3-28 10:27 | 只看该作者

10K就可以了

10K就可以了

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地板
techbaby| | 2009-3-28 10:29 | 只看该作者

那要看你如何接法了

若当成外部RAM，不用上拉；
当成普通I/O口用，1k上拉应该可以。

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5楼
fzpxp|  楼主 | 2009-3-28 12:32 | 只看该作者

我只当普通I/O口用，作为液晶的数据线或控制线

我只当普通I/O口用，作为液晶的数据线或控制线。P0已经焊上了1K的排阻，就怕对屏幕不好，所以问问。

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6楼
fzpxp|  楼主 | 2009-3-28 13:45 | 只看该作者

请看图片

请看图片，是12864的参数说明。其中supply current for logic IDD为2.62-4mA。那么我P0口上拉电阻是不是应该在5V/2.62与5V/4之间，也就是1.25-1.9K之间？请指教

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7楼
smileagain| | 2009-3-28 14:59 | 只看该作者

总感觉1k的上拉太强了

强上拉的缺点是低电平下不来
一般不去详细计算上拉电阻具体是多少，特别是对于lcd这种低功耗器件来说
对于P0口，通常用10k是比较保险的，能应付绝大部分的场合

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8楼
McuPlayer| | 2009-3-28 15:15 | 只看该作者

上拉的本质不能搞错

“强上拉的缺点是低电平下不来”，这话不该出自21IC电工之口。

上拉是因为P0口内部的PMOS驱动能力弱，当IO的负载重的时候，IO的电压会降落。

像一般PIC之类单片机的Push-Pull模式下，如果把PMOS等效成上拉电阻看，只有几十个到一百个欧姆的样子。

那强上来有缺点吗？
当然有，因为电阻上拉跟PMOS的上拉不同，PMOS可以关断，而电阻是一直导电的。所以输出低电平的时候，强上拉，上拉电阻耗电很大的。
比如5V系统，1K上拉，低电平的灌电流就有5mA，考虑8个IO口就有40mA了。

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9楼
yangjian218| | 2009-3-28 16:21 | 只看该作者

顶一下

楼上的分析很精辟，学习了

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10楼
fzpxp|  楼主 | 2009-3-28 19:50 | 只看该作者

谢谢各位

可否结合我在6楼发的LCD参数，用具体计算来说明，上拉电阻到底用多少合适呢？

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11楼
linjiguang| | 2009-3-28 22:25 | 只看该作者

建议用10k

建议用10k,电阻太小将使系统功耗增加，电阻太大将使系统的抗干扰能力减弱。1k的上拉电阻，输出电平0时需要灌入约5mA的电流（电源5V的情况下）。当系统的上拉电路用的比较多时，这是一个不可不重视的问题。

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12楼
McuPlayer| | 2009-3-28 22:31 | 只看该作者

你提供了什么参数？

0、已经都是5V系统了，都是CMOS的，所以你提供的数据只有看看的意义了
1、IO口的输入电容有多大（再加上信号线上的等效电容）
2、你数据读写的速度，对信号的setuptime和holdtime的要求

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13楼
chinaboy20| | 2009-3-29 06:58 | 只看该作者

i 服 you

楼上是高手，i 服 you！！

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14楼
actionsai| | 2009-3-29 08:48 | 只看该作者

10K

我用的上拉就是10K

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15楼
smileagain| | 2009-3-29 18:28 | 只看该作者

谢谢8楼高人指点

虽然还不是很明白，不过还是学习了，还好没有误人子弟，呵呵
以后有机会再请教切磋

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16楼
fzpxp|  楼主 | 2009-3-30 09:54 | 只看该作者

谢谢各位，还是有点迷糊，我慢慢体会一下吧

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17楼
songbangyan| | 2009-3-30 12:35 | 只看该作者

强人太多，被唬到

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18楼
C1rcas| | 2013-2-11 18:21 | 只看该作者
这回领教了上啦下拉电阻，

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19楼
bisiwuyi| | 2014-5-14 21:01 | 只看该作者
本帖最后由 bisiwuyi 于 2014-10-22 21:50 编辑
McuPlayer 发表于 2009-3-28 15:15
“强上拉的缺点是低电平下不来”，这话不该出自21IC电工之口。上拉是因为P0口内部的PMOS驱动能力弱，当IO的 ...

P0口确实。

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