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两根单向的IO(只能做输出用)能否扩展出带锁存的8bit并口？

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楼主
菜鸟狒狒|  楼主 | 2007-12-20 04:28 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
IO, 移位, 寄存器, 移位寄存器
 用移位寄存器，没有锁存功能，在移位的时候数据是乱的。
 带锁存功能就得三根IO了。

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沙发
ocon| | 2007-12-20 04:59 | 只看该作者

一根输出线就够了，最常见的是异步串口。

搜一下“USART”

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板凳
hotpower| | 2007-12-20 06:04 | 只看该作者

一般2线用74hc164,3线用74hc595等

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地板
xwj| | 2007-12-20 08:49 | 只看该作者

呵呵，题目没写好，让人误解成通讯了

LZ的意思是能否用2根线接 串入并出移位寄存器 而让移位时端口不乱码
而不是接CPU

这个必须的控制选通脚
用3根线是最简单方便的办法，非要2根线的话用门电路搭个封锁时序去控制OE脚，但是太麻烦，好像没必要哦

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5楼
forthlab| | 2007-12-20 10:17 | 只看该作者

LS的正解

有个设计，插座管脚不够，就是用的外接电路生成输出触发控制信号的，用NPN三极管和RC作的，还好，一直很稳定。成本也不高

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6楼
iaiwork21| | 2007-12-20 15:17 | 只看该作者

如果8bit输出是点数码管之类的话

2根线控制164也没问题的，送显前关公共端，显示不会乱的

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7楼
ayb_ice| | 2007-12-20 19:48 | 只看该作者

8位输出可以，输入不行

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8楼
菜鸟狒狒|  楼主 | 2007-12-21 00:18 | 只看该作者

呵呵，4楼，当然是有些条件约束才会想用两根线的啦

 5楼的方案是不是这样的：

  当有CLK为0时电容放电并延迟，使得数据锁存，CLK在一段时间内总是高电平则认为无CLK信号，电容电充足了就触发数据锁存？

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9楼
computer00| | 2007-12-21 01:22 | 只看该作者

恩，这个方案可行。

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10楼
forthlab| | 2007-12-21 08:07 | 只看该作者

我把我的图纸给你参考一下,参数你要根据你的CLK频率再调整

用示波器看看就能确定.
因为我的CLK是反相的,所以要接个三极管,如果CLK相位正确,直接用个二极管就可以的.

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11楼
forthlab| | 2007-12-21 08:12 | 只看该作者

我的图纸STR接595的12触发管脚的,

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12楼
菜鸟狒狒|  楼主 | 2007-12-23 12:33 | 只看该作者

多谢ls，不过这个还是感觉不太可靠，尤其是延迟时间不定

 温度性能等，要是能搞个时序纯数字电路控制就好了；。

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