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69P24内部上拉问题

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楼主
冰清玉洁|  楼主 | 2013-5-18 21:26 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
信号, 端口, 电平, 上拉电阻, 电阻
69P24，芯片上电初始化，设置端口(我用到的是PB0口)为输入上拉，端口置1。外部无上拉电阻。悬空端口，理论上设置完成后检测到的信号应该为高电平信号。但是实际是在上电200ms左右的时间内检测到的是低电平信号。

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沙发
wenfen| | 2013-5-18 21:28 | 只看该作者
需要设置内部上拉有效时间吧

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板凳
冰清玉洁|  楼主 | 2013-5-18 21:30 | 只看该作者
嗯，需要多长呢？

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地板
zhuhuis| | 2013-5-18 21:31 | 只看该作者
PB0是高压烧写口，open-drain的，没有寄存器设置上拉

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5楼
冰清玉洁|  楼主 | 2013-5-18 21:33 | 只看该作者
疏忽了，原来端口留做它用的。

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6楼
tian111| | 2013-5-18 21:35 | 只看该作者
晕啊

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7楼
冰清玉洁|  楼主 | 2013-5-18 21:36 | 只看该作者
哎，后来有改动就直接拿来用了，忘了这个问题

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8楼
宋倩2010| | 2013-5-18 21:38 | 只看该作者
还好觉悟的快

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9楼
冰清玉洁|  楼主 | 2013-5-18 21:54 | 只看该作者
呵呵，是啊，先结贴了

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