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用FPGA 输出的矩形波上升沿和下降沿都有毛刺，怎么解决？

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zp1982|  楼主 | 2007-11-26 18:29 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
FPGA, 矩形, 布线, 晶振, 电路
用FPGA 输出的矩形波上升沿和下降沿都有毛刺，怎么解决？
测晶振输出端波形的波谷和波峰处均有抖动，是电路设计的问题还是布线啊？怎么解决呢？ 

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沙发
王紫豪| | 2007-11-26 18:55 | 只看该作者

你说的是过冲吧？这个是正常现象！

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板凳
weimd| | 2007-11-26 21:47 | 只看该作者

串电阻

串电阻会好些
不过是以牺牲电压上升时间为代价的

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地板
王紫豪| | 2007-11-26 22:19 | 只看该作者

时钟要得其实就是那个“沿”，没关系的！

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5楼
pk.kong| | 2007-11-26 22:46 | 只看该作者

用PCB软件仿真看看,是否影响,计算一下.

如果有影响,就用终端匹配.
软件提供若干种匹配方法,看那种效果好,有好实现.
我这样做的,ad6有这类的仿真,candence也有 .

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6楼
zp1982|  楼主 | 2007-11-28 16:05 | 只看该作者

软件提供若干种匹配方法？

谢谢各位了。
5楼说的“软件提供若干种匹配方法”主要是指什么啊？

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7楼
syzdq| | 2007-11-29 09:31 | 只看该作者

过冲如果不引起逻辑翻转或IC栓锁甚至烧坏，不端接也行。

当然也不能太临界。
相关知识请自己查SI（信号完整性）。

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8楼
zp1982|  楼主 | 2007-11-29 11:07 | 只看该作者

感觉好象是振荡啊

仔细看了一下输出波形，感觉好象是振荡啊，持续时间有0.5uS左右才逐渐稳定下来。

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9楼
syzdq| | 2007-11-29 11:57 | 只看该作者

已经产生振铃的话就要端接。

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10楼
zp1982|  楼主 | 2007-11-29 18:47 | 只看该作者

端接 是什么意思啊？

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