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[Verilog HDL]

cadence 16.3版本安装问题

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wsp51548116|  楼主 | 2013-7-19 15:01 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
cadence, project, AC, RAM, se
cadence 16.3版本Cadence_Allegro_SPB_16.3，但是在新建设计项目打开项目管理器和添加元件库的时候出现问题 ，在项目设置的时候，
1  打开项目管理器project manager,单击create design project项，
      2在project name 输入ram_module

     3.单击location区域的浏览按钮，查找user1/ftb目录，单击将其打开，在location区域在路劲的末尾添加\ram.

  我到这里找不到这个user1\ftb目录，知道我这个问题出在哪里嘛，谢谢











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沙发
梅花望青竹| | 2013-7-24 22:10 | 只看该作者
怎么看起来这么麻烦？

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板凳
梅花望青竹| | 2013-7-24 22:11 | 只看该作者
不知道楼主要干什么的？

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