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请教verilog测试向量的写法

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limee|  楼主 | 2007-5-6 13:51 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
向量, verilog, INA, Output, TPU
谁能够贴个testbench的例子啊？

//////////////////////////////////////////////////
//
// 4位全加器的verilog代码

module adder4( cout, sum, ina, inb, cin ) ;
   output[3:0] sum ;
   output cout ;
   input[3:0] ina, inb ;
   input cin ;
   assign { cout, sum } = ina + inb + cin ;
endmodule

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