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有谁能解释此程序的运行结果吗？

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楼主
stoneymumu|  楼主 | 2007-5-18 10:48 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
module, initial, top, TI, ST
module exc2;
    reg[7:0] c;
    initial begin
        c=8`d250*8`d2;    //结果分析
    #1000 $stop;
    end
    endmodule

运行结果是c=64
这是为什么呀？我的分析是250*2=500=111110100B，取低八位c=11110100B=244。哪里分析错了，谁能解释一下吗？

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沙发
yb840311| | 2007-5-18 11:15 | 只看该作者

答

    reg[7:0] c;把前的范围放大，如reg[15:0] c;再试一下，哪样计算结果已经溢出了。

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板凳
stoneymumu|  楼主 | 2007-5-18 12:43 | 只看该作者

问

c定义8位的话指定会溢出
但溢出后应该是244吧，为什么会变成64呢，就是这点搞不明白……

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地板
yb840311| | 2007-5-19 10:01 | 只看该作者

哪我也就不明白了

也许在Verilog中，值溢出后，c是随机给的，和C语言中不一样了

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