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关于erilog中"#"中用法的问题

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楼主
cdmp3|  楼主 | 2007-8-15 07:34 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
仿真, 定时, 硬件, 参考设计
在一些资料的参考设计中,经常会用到"#"定义门延时,在仿真是用事件管理器实现,而在真实的硬件中是如何实现的?通过什么来定时?还是进对仿真有效?多谢高手指点。

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沙发
dpirly| | 2007-8-16 17:48 | 只看该作者

呵呵

实际综合时会忽略定时信息的！

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板凳
_horse| | 2007-8-17 19:20 | 只看该作者

一起学习

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地板
gwbing| | 2007-8-18 13:01 | 只看该作者

对仿真有效

对仿真有效

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5楼
lake198664| | 2007-8-21 10:26 | 只看该作者

反问一下

   我想请教一下下，什么是erilog啊，呵呵

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6楼
_horse| | 2007-8-21 11:26 | 只看该作者

veriloghdl

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7楼
cdmp3|  楼主 | 2007-8-23 10:10 | 只看该作者

多谢了.

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