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在用CPLD读写SRAM的时候如何设定引脚方向？输入和输出

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楼主
ocon|  楼主 | 2008-1-2 06:44 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
CPLD, SRAM, 引脚, 读写, inout
我定义了这样一个数据总线：
inout [15:0]data;
接下来如何操作？
试过如果定义成input [15:0]data，可以读取SRAM的内容，但不知道如何将它设成输出口来往SRAM写数据。

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沙发
ocon|  楼主 | 2008-1-2 06:50 | 只看该作者

翻了3本书，网上搜了半天，没有查到答案。

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板凳
ocon|  楼主 | 2008-1-2 06:51 | 只看该作者

用的是verilog hdl

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地板
ocon|  楼主 | 2008-1-3 22:50 | 只看该作者

收到，谢谢啦。

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