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fpga配置过程中 IO电平问题??

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atao涛|  楼主 | 2008-4-16 16:19 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
  各位大侠:
         FPGA 在上电 到 配置完成 期间(配置过程中)   IO电平是 什么电平????   是 不定态???   还是 可以设置???
         我用 SPARTAN 3  XC3S400  做了 一个 实验,,,把 HS_EN脚分别  拉高和 拉低,,  用灯去显示 IO脚的状态,,,,发现 在上电后 还是有瞬间灯亮,, 后才进入配置的状态,, 

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沙发
zgl7903| | 2008-4-17 09:33 | 只看该作者

先擦除,再上电一次看看?

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