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输入信号在时钟触发沿变化

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楼主
52wm|  楼主 | 2008-4-28 14:28 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
信号, 时钟, 触发, CPLD, PLD
初学CPLD
我在做波形仿真时,出现一个奇怪的现象
输入信号在时钟触发沿变化时,就出现了
不口可预料的结果.
请问如何防止了?

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沙发
drentsi| | 2008-4-29 13:09 | 只看该作者

顶2楼的2个D触发器

至于为什么不用1个D触发器而要用2个D触发器，没实践过的肯定不知道

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and| | 2008-5-1 00:29 | 只看该作者

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