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CYCLONE PLL 的问题

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feige5203|  楼主 | 2008-5-4 09:08 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我altera的ep1c6内部pll锁相倍频,外部输入的20M的正弦信号,低电平是0v,高电平是3.3v,为什么2倍频之后的输出信号低电平是1.2v左右,高电平是2.1v左右啊(频率是40M),用示波器直流耦合看的啊。我把倍频的频率的改成一倍,信号输出就和输入的信号频率和电平一致,为什么啊,有知道的大侠吗?

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