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将FPGA输出引脚设为高阻的问题

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herozoujie|  楼主 | 2008-7-28 17:13 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
FPGA, 引脚, IO端口, Output, TPU
把一个output设置成Z，用示波器去观察，结果发现电压读数1.97V，IO端口是3.3V驱动的，正常吗？高阻时读数应该是0吧

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沙发
jzt369| | 2008-7-29 13:13 | 只看该作者

未必

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小李志| | 2008-7-31 12:34 | 只看该作者

既然已经高阻了

高阻只是防止总线冲突，你已经决定不用它了，那就不用7关心他的电平拉

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地板
herozoujie|  楼主 | 2008-8-1 10:30 | 只看该作者

收益不少

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5楼
wwwwggggqqqq| | 2008-9-28 14:36 | 只看该作者

这是正常的

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