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actel编译器报错，altera的正常

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楼主
wangkj|  楼主 | 2009-6-3 10:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
Actel, altera, 编译器, VGA, Behavior
reg[15:0] pixcel_buf[15:0];//16*16 bit refresh tft screen data buffer

Error: NETLIST:001 Behavioral HDL is not supported. Module vga has behavioral code in FILE E:vga_lcdmini2440verilogVGAh

这可是 verilog的标准语法啊。

altera就没问题。

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沙发
wangkj|  楼主 | 2009-6-3 17:14 | 只看该作者

是软件安装问题，重新安装后正常

是软件安装问题，重新安装后正常

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板凳
patrick007| | 2009-6-3 21:47 | 只看该作者

re

重装，重启有时候还真是法宝。：）

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地板
Fourier00| | 2009-6-4 21:43 | 只看该作者

reg[15:0] pixcel_buf[15:0]

reg[15:0] pixcel_buf[15:0]
老王这个是rtl代码还是仿真代码啊？

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5楼
wujing198| | 2009-6-4 23:15 | 只看该作者

可综合的

不然Altera的还不报错？标准的16*16存储单元描述方式。

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6楼
Fourier00| | 2009-6-20 19:05 | 只看该作者

明显的软件写法

明显的软件写法  ，不知道会给综合成ram还是寄存器

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7楼
钻研的鱼| | 2009-6-23 08:22 | 只看该作者

xilinx 的一些源码里面也有这种写法

两维数组一般用于存贮器里

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8楼
beinghu| | 2009-7-18 22:16 | 只看该作者

这是verilog2001的语法吧

缺省的是95版语法，你得告诉它你用2001。

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9楼
lianshumou| | 2009-11-30 15:35 | 只看该作者
1# wangkj


你有描述有问题,通常的描述是 reg[15:0] pixcel_buf[0:15];//

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10楼
tear086| | 2011-11-10 11:16 | 只看该作者
9# lianshumou
Quartus II 大端小端都支持的。

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