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LVCMOS25的问题

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shajiayu|  楼主 | 2013-8-13 14:30 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
CMOS, 电平, FPGA, PGA, IO
xilinx的芯片如果IO被配置成LVCMOS25，输出的时候肯定是高电平2.5V，这样即便对方是3.3V标准的一般也能检测。如果对方给的3.3V高电平的信号，FPGA肯定能查询到高电平。但是这样会不会损坏FPGA的IO口呢？还是没问题呢？

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雪夜虫子| | 2013-8-13 14:59 | 只看该作者
本帖最后由 雪夜虫子 于 2015-7-23 09:21 编辑

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板凳
gdxizhilang| | 2013-8-13 15:51 | 只看该作者
:)，数字电平

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地板
shajiayu|  楼主 | 2013-8-15 10:46 | 只看该作者
好吧，结贴了

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