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关于ＭK10DＸ256VLL7的一个问题，我想多半是freescale的问题。

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楼主
dongshan|  楼主 | 2013-9-12 08:33 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
freescale, AC, 寄存器, 芯片, AN
本帖最后由 FSL_TICS_Admin 于 2013-9-23 17:01 编辑

我在使用ＭK10DＸ256VLL7做一个项目，当用PE配置PORTA时，发现每个pin都有一个digital filter的功能(下面以PORTA为例)，这个功能从PE自动生成的代码来看，是操作了PORTA_DFER, DFPORTA_CR, PORTA_DFWR三个寄存器，如下图：


从freescale提供的芯片头文件中发现，这几个寄存器在此PORT模块memory map中的偏移地址分别是：0xc0, 0xc4, 0xc8，如下图：


可奇怪的是，我找遍芯片的datasheet, 及其相应的reference mannual，都没发现这几个寄存器的介绍及功能说明，这种自相矛盾，左右互博的做法，究竟是怎么回事？如下图：

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沙发
dongshan|  楼主 | 2013-9-12 09:51 | 只看该作者
请技术小组支持一下，看看到底是怎么回事？

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板凳
FSL_TICS_Robin| | 2013-9-12 10:07 | 只看该作者
dongshan 发表于 2013-9-12 09:51
请技术小组支持一下，看看到底是怎么回事？

你的这块芯片型号的确没有你所说的这些寄存器，你可以去下载120MHz的K10的参考手册K10P144M120SF3RM，里面有这些寄存器和相应功能介绍。

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地板
FSL_TICS_A| | 2013-9-12 11:33 | 只看该作者
K10 72MHz 产品IO管脚数字滤波功能不支持了，所以没有这几个对应的寄存器。在配置PE的时候就不要选择使能数字滤波了。

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5楼
dongshan|  楼主 | 2013-9-12 13:50 | 只看该作者
谢谢楼上二位，明白了。
ＰＥ在选择相应的型号后，没有的功能应该屏蔽的。
另外，cw 10.4提供的头文件却有这些寄存器的定义，这样做就不对了。

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6楼
FSL_TICS_Admin| | 2013-9-12 14:10 | 只看该作者
正如你所知道的，PE这个功能的组件非常多，对应产品也非常多，所以疏忽在所难免。我们会将这个问题报告给CodeWarrior组的。也要感谢你的细心和对飞思卡尔产品的关注。

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