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FPGA引脚分配全满的话编译的时候会不会有问题？

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楼主
jlgcumt|  楼主 | 2013-9-24 10:19 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
FPGA, PGA, 引脚, 编译
FPGA引脚分配全满的话编译的时候会不会有问题？
用的EP2C50F484I8!逻辑宏大约用掉3万多个！

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沙发
myx0709| | 2013-9-24 10:22 | 只看该作者
引脚分配满应该没问题吧，不然它提供那么多引脚干嘛。只是信号太多了，是里面的逻辑不够用或者逻辑满足不了时序要求，才会导致有问题吧...个人理解，请多讨论

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板凳
雪夜虫子| | 2013-9-24 11:04 | 只看该作者
本帖最后由 雪夜虫子 于 2015-7-23 09:17 编辑

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