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[FPGA]

有关AD9914手册中的DAC校准

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JokerLone|  楼主 | 2013-10-22 14:35 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
DAC校准输出:CFR4控制寄存器(0x03[24])中的DAC CAL使能位必须手动设置,并且每次上电以及每次REF_CLK或内部系统时钟改变以后需清零。它触发内部校准程序,以优化内部DAC时序的建立和保持时间。校准失败可能降低性能,甚至导致功能帮障。校准DAC时钟的时间长度通过下式计算:t=531840/fs.

这是AD9914 datasheet中的一段说明,不知道有没有高人指点一下这个校准时间长度是什么意思?另外有人做过DDS AD9914芯片的相关研究么,到处都没有相关资料啊:'(

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沙发
JokerLone|  楼主 | 2013-10-23 15:39 | 只看该作者
:(:'(

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板凳
GoldSunMonkey| | 2013-10-24 23:07 | 只看该作者
这个真不会

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地板
JokerLone|  楼主 | 2013-10-25 14:13 | 只看该作者
GoldSunMonkey 发表于 2013-10-24 23:07
这个真不会

好吧,还是谢谢了

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GoldSunMonkey| | 2013-10-25 23:11 | 只看该作者
JokerLone 发表于 2013-10-25 14:13
好吧,还是谢谢了

没办法,我不是关注在这里的

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mengz| | 2013-11-7 00:08 | 只看该作者
校准需要的时钟周期个数,根据你的时钟频率计算所需时间

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