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同呼唤大神，如何在一个vhdl中同时用上升和下降沿

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楼主
nm2012|  楼主 | 2013-11-3 22:58 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
HDL, VHDL, hd, 时钟
就一路时钟输入

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沙发
ococ| | 2013-11-4 08:41 | 只看该作者
最好不要同时用上升沿和下降沿。
可以将时钟2倍频后使用上升沿。

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板凳
shenqibear| | 2013-11-4 16:46 | 只看该作者
同一个进程是不可以的，会报错。你可以在两个进程中做。

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地板
yghanwuji| | 2013-11-4 22:34 | 只看该作者
你可以将输入时钟非门后赋值给另外一个信号作为下降沿时钟

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5楼
Backkom80| | 2013-11-5 07:58 | 只看该作者
同一个进程中不可以同时用上升沿和下降沿，底层无相应的器件与此对应，综合会报错

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6楼
wq2437| | 2013-11-5 19:55 | 只看该作者
2楼正解。

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7楼
chenkui456| | 2013-11-5 20:31 | 只看该作者
pll偏移180°即可

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8楼
wwxmud| | 2013-11-5 21:55 | 只看该作者
2 楼 7 楼都可

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9楼
weshiluwei6| | 2013-11-27 13:43 | 只看该作者
VHDL不可以 報錯 我試過的

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10楼
cuianbin| | 2013-11-27 16:59 | 只看该作者
同意二楼

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11楼
geniusxian| | 2013-12-24 22:08 | 只看该作者
设计两个process，每个process一个变量，就可以了。

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