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视频FPGA技术指导

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eaglewgliu2|  楼主 | 2013-11-12 10:47 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
价格:5000 元
本帖最后由 eaglewgliu2 于 2013-11-14 19:16 编辑

项目背景:
1、采用LFE3-17EA-6FN484I硬件平台
2、要实现将通过LVTTL接收到的4路BT1120视频信号打包,通过SERDES传输出去。
3、在未加FRAME BUFF,DDR IP, 可以实现一收一发正常显示,但因视频源有的产生的P_CLK并不标准,所以需要通过FRAME BUFF将其转变为标准的视频信号。

要实现功能:
  1、将原厂FRAME BUFF, DDR等IP成功集成到现项目代码中,能正常输出图像。

对承包人要求:
  1、地点在北京。
  2、成功应用过这两个IP。对视频信号非常熟悉。

   联系qq:774692354

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hwwss| | 2013-11-12 14:55 | 只看该作者
做假用的。坑人

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lirunze| | 2013-11-12 18:24 | 只看该作者
是吗

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hwwss| | 2013-11-12 21:56 | 只看该作者
我就被坑过一次

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lycclycc520| | 2013-11-13 13:26 | 只看该作者
深圳方案公司可以帮你完成,qq:223265328  

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328535231| | 2013-11-13 19:59 | 只看该作者
会做,但是不能做

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qinxiongxu| | 2013-11-13 22:38 | 只看该作者
BS~~

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1994342704| | 2013-11-14 10:44 | 只看该作者
假的外包,原来也是做广告啊

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