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[Verilog HDL]

基于FPGA的用verilog hdl编写16位CPU程序

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prince梅子54|  楼主 | 2013-11-20 22:39 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
CPU, FPGA, 编写, HDL, verilog
基于FPGA的用verilog hdl编写16位CPU程序，完成如下的汇编指令
1. ADDi  kreg,ii     //将立即数ii与kreg的值相加，并存在kreg
  ADDi  kreg,-ii
  ANDi  kreg,ii
  ORi   kreg,ii
  XORi  kreg,ii
  LDi   kreg,ii
2. ADD  kreg,mreg   //将mreg的值与kreg的值相加，并存在kreg
  AND  kreg,mreg
  OR   kreg,mreg
  XOR  kreg,mreg
  MOV  kreg,mreg

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沙发
gaochy1126| | 2013-11-26 17:25 | 只看该作者
不知道楼主要表达什么的

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