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wjddyj|  楼主 | 2014-1-9 20:42 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
信号, 电平, FPGA, PGA, 控制
通过FPGA逻辑变换产生一个信号，信号可以按预先设定，在任意时刻进行高低电平变换（变换次数不超过20次），只是实现这个应该比较容易。。。。。。但现在问题是，如果要同时控制64路信号，128路信号，让其都能独立在任意时刻进行高低电平变换(各路信号独立，变换次数不超过20次)，这个怎么做？

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