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如何用verilog实现时钟的相位延迟？

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技术达人|  楼主 | 2014-2-24 13:34 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
verilog, 时钟, 相位, verilo
如何用verilog实现时钟的相位延迟？：http://forums.xilinx.com/t5/%E7% ... 8%BF%9F/td-p/398761

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沙发
ifpga| | 2014-3-4 21:40 | 只看该作者
？？

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GoldSunMonkey| | 2014-3-6 00:08 | 只看该作者
这个只能这样，有高速时钟来分频调整了。
但是精度很差

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